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kok真人:正点原子斥地者FPGA开采板材料连载第十一章 静态数码管闪现实行

发布时间:2021-12-16 11:46:49 来源:kok直播 作者:kok直播网页版

  数码管是一种摩登常用的数码显示器件,拥有发光显示清爽、呼应速率疾、功耗低、体积

  幼、寿命长、易于节造等诸多便宜,正在数显仪器仪表、数字节造兴办等方面取得渊博使用。本

  数码管也称半导体数码管,它是将若干发光二极管按必定图形分列并封装正在一同的一种数

  码显示器件。常见的数码管如图 11.1.1所示,这种数码管紧要被称为八段数码管或8字形数码

  除了常用的八段数码管除表,较常见的另有“±1”数字管、“N”形管、“米”字管以及

  不管是什么体式的数码管,其显示道理都是点亮内部的发光二极管来发光。那么何如用数

  数码管内部电道如图 11.1.3所示,从该图可能看出,一位数码管的引脚是10个,此中7个

  引脚对应贯穿到构成数码管中央“8”字型的led,Dp引脚贯穿到数码管的幼数点显示led(dp)。

  终末另有两个大家端,分娩商为了封装同一,单个数码管都封装成10个引脚,此中8和3两个公

  共端引脚(图中为com)是贯穿正在一同的。大家端又可分为共阳极和共阴极,图 11.1.3(b)

  对共阴极数码管来说,其8个发光二极管的阴极正在数码管内部所有贯穿正在一同,以是称“共

  阴”,而阳极独立。对共阳极数码管来说,其8个发光二极管的阳极正在数码管内部所有贯穿正在

  一同,以是称“共阳”,而阴极独立。以共阳极数码管为例,当咱们思让数码管显示数字“8”,

  可能给a、b、c…g七个引脚送低电平,数码管就显示“8”,显示数字“1”,就给b、c引脚低

  当多位数码管使用于某一编造时,为了省略数码管占用的I/O口,将其段选(数码管的a、

  b、c等引脚)贯穿正在一同,而位选(数码管的大家端)独立节造。如此咱们可能通过位选信号

  节造哪几个数码管亮,况且正在同偶尔刻,位选选通的所稀有码管上显示的数字永远都是相通的,

  由于它们的段选是贯穿正在一同的,以是送入所稀有码管的段选信号都是一样的,数码管的这种

  对待静态显示另有一种是数码管的每一个码段都由一个孑立的I/O端话柄行驱动,其便宜

  是编程较为浅易,显示亮度较高;欠缺是占用I/O较多,当数码管较多时,务必扩大译码驱动

  器实行驱动,或操纵串口转并口芯片来拓展端口。所以对待多位数码管的操纵,平常都采用前

  一种格式实行电道安排,这种电道安排更为便当的是以动态格式驱动数码管。动态显示与静态

  显示的区别枢纽正在于位选的节造。因为静态显示容易杀青,本章咱们以6位共阳数码管的静态

  本节试验义务是操纵FPGA开荒板上的6位数码管以静态格式顺次显示000000、111111、

  咱们的拓荒者FPGA开荒板上有6位共阳数码管,其道理图如图 11.3.1所示。正在这里咱们需

  要属意的是,为了扩大FPGA输出信号的驱动才智,咱们操纵PNP型三极管驱动数码管的位选段,

  遵循试验义务,咱们可能大致经营出编造的节造流程:开始咱们须要一个静态数码管显示

  模块正在数码管上显示数据,其次须要一个计时模块每当计时到0.5s时调度数码管显示的数值。

  管静态显示模块(seg_led_static),杀青各模块之间数据的交互。计时模块将计时到0.5s时

  的标识信号flag转达给数码管静态显示模块,数码管静态显示模块给与到此信号时显示的数值

  计时模块(time_count):计时模块对编造时钟实行计数,当计时到给定值(此处指0.5s)

  数码管静态显示模块(seg_led_static):数码管静态显示模块正在数码管上以静态格式显

  顶层模块紧要结束对其余模块的例化。代码第13行的参数TIME_SHOW节造数码管每隔多长

  期间调度显示的数值,该参数值与代码第35行的clk时钟信号频率相闭。因为例化时clk为编造

  代码中第11行的参数MAX_NUM为计数的最大计数值,因为是对时钟计数,相当于计时,第

  不然标识为“1”,而且计数器cnt清零。通过SignalTapII抓到的波形图如下图所示:

  代码第11行的num信号为数码管显示的数值,由代码第30行的if语句块可知,其能显示的

  数值为0~f。因为开荒板上的数码管为共阳数码管,以是不显示幼数点时该位值为“1。

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